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PLL
美
英
n.
锁相环路;多聚L-赖氨酸
网络
锁相环(phase-locked loop);锁相回路;锁相环电路
英汉
网络释义
n.
1.
锁相环路
2.
多聚L-赖氨酸
1.
锁相环(phase-locked loop)
锁相环
(
pll
):是一种实现相位自动锁定的控制系统。它一般有鉴相器、环路滤波器、压控振荡器等部件组成。
gzaswhl.blog.163.com
|
基于23940个网页
2.
锁相回路
在
锁相回路
(
PLL
)中,相位比较器的作用类似於 (A)加法器 (B)减法器 (C)乘法器 (D)除法器。
www.twowin.com.tw
|
基于1897个网页
3.
锁相环路
先进的
锁相环路
(
PLL
)PLL (phase-locked loop)锁相环路是指这个装置中有一个由相位检测器,环路滤波器,电压控制震荡器以 …
detail.net114.com
|
基于1280个网页
4.
锁相环电路
采用
锁相环电路
(
PLL
),可同时记忆18个电台. 4),视频部分(video)的特点: (1)自动识别CD和VCD碟片.(2)同时安装8枚碟片(CDC功 …
www.5doc.com
|
基于1054个网页
5.
数字锁相环(Phase Lock Loop)
单
数字锁相环
(
PLL
)结构,低抖动 2千伏静电防护能力 低功耗设计,应用于笔记本电脑时会尽可能的最大化电池使用时间 支 …
cn.siliconimage.com
|
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例句
释义:
全部
全部
,
锁相环路
锁相环路
,
锁相回路
锁相回路
,
锁相环电路
锁相环电路
类别:
全部
全部
,
口语
口语
,
书面语
书面语
,
标题
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,
技术
技术
来源:
全部
全部
,
字典
字典
,
网络
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难度:
全部
全部
,
简单
简单
,
中等
中等
,
难
难
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1.
One
important
application
of
PLL
in
microprocessor
is
to
provide
on
-
chip
clock
for
the
system
.
It has been
a
core
module
of
microprocessor
.
锁
相
环
在
微处理器
领域
中
的
一个
重要
应用
就是
为
系统
提供
片
内
时钟
,
它
是
微处理器
时钟
电路
中
的
核心
模块
。
www.fabiao.net
2.
Because of the
better
spur
control
than
DDS
,
the
Phase
Locked
Loop
(
PLL
)
frequency
synthesis
is
usually
used
in
frequency
agile
synthesis
.
锁
相
频率
合成
(
PLL
)
具有
比
DDS
更
优秀
的
杂
散
抑制
能力
,
常
用于
捷变
频率
合成
。
lib.cqvip.com
3.
Compared
with
the
structure
of
the
commonly
used
PLL
circuit
,
that of the
circuit
implemented
by
this
way
is
simpler
and
easier
to be made
.
用
该
方法
实现
的
电路
,
比
通常
所
用
的
锁
相
环
电路
结构
简单
,
而且
易于
实现
。
megust.publicvm.com
4.
If
the
frequency
offset is
large
enough
,
the traditional
PLL
cannot
be
locked
.
Such
situation
would
lead
to
the
system
corruption.
当
频
差
较大
时
,
接收
端
用于
载波
恢复
的
锁
相
环路
无法
锁定
,
导致
系统
不能
正常
工作
。
www.ceps.com.tw
5.
The
PLL
includes
a
phase
frequency
detector
,
a
charge
pump
,
a
low
pass
filter
,
a
voltage
controlled
oscillator
and
a
frequency divider
.
该
PLL
电路
由
一个
鉴
频
鉴
相
器
电路
、
一个
电荷
泵
、
一个
低
通
滤波器
、
一个
压
控
振荡
器
和
分频
器
组成
。
epub.cnki.net
6.
Therefore
,
a
more
thorough
analysis
of
the
output
jitter
,
taking into
account
optimal
loop
bandwidth
selection
, is
provided
in
this paper
.
因此
,
本文
在
考虑
最优
带宽
选择
的
情况
下
,
对
PLL
输出
时钟
抖动
特性
进行
了
更
深入
的
研究
。
www.13191.com
7.
The
objective
of
the
thesis
is
to
explore
the
noise
sources in
PLL
and
find
the proper
circuit
structures
to
reduce
the
noise
effects
.
本文
的
目的
是
研究
目前
应用
最
广
的
电荷
泵
锁
相
环
的
噪声
特性
以
寻找
减小
环路
噪声
的
电路
架构
。
www.juhe8.com
8.
Application of the
hardware
PLL
technology
can
achieve
the
synchronous
sampling
more
effectively
and
help
improve
the
sampling
accuracy
.
采用
了
硬件
锁
相
环
技术
,
可
更加
有效
实现
同步
采样
,
提高
了
采样
精度
。
www.apshe.cn
9.
USPIO-
PLL
,
as
an
intracellular
contrast
agent
,
can
label
endothelial
progenitor
cells
with
high efficiency
.
利用
USPIO-PLL
作为
细胞
内
造影
剂
可以
高效
标记
内皮
祖
细胞
。
www.fabiao.net
10.
The
second
local
frequency
signal
is provided
by
an
integer
-
divider
after
PLL
output
.
二
次
变频
的
本
振
信号
由
PLL
的
输出
信号
经
整数
分频
得到
。
www.boshuo.net
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